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Si4736/37/38/39-C40
Table 7. SPI Control Interface Characteristics
(V DD = 2.7 to 5.5 V, V IO = 1.85 to 3.6 V, T A = –20 to 85 °C)
Parameter
SCLK Frequency
SCLK High Time
SCLK Low Time
SDIO Input, SEN to SCLK ?? Setup
SDIO Input to SCLK ?? Hold
SEN Input to SCLK ? ? Hold
SCLK ? ? to SDIO Output Valid
SCLK ? ? to SDIO Output High Z
SCLK, SEN, SDIO, Rise/Fall time
Symbol
f CLK
t HIGH
t LOW
t S
t HSDIO
t HSEN
t CDV
t CDZ
t R , t F
Test Condition
Read
Read
Min
0
25
25
15
10
5
2
2
—
Typ
—
—
—
—
—
—
—
—
—
Max
2.5
—
—
—
—
—
25
25
10
Unit
MHz
ns
ns
ns
ns
ns
ns
ns
ns
Note: When selecting SPI mode, the user must ensure that a rising edge of SCLK does not occur within 300 ns before the
rising edge of RST.
SCLK
70%
30%
t R
t F
SEN
70%
30%
t S
t S
t HIGH
t LOW
t HSDIO
t HSEN
SDIO
70%
30%
C7
C6 –C1
C0
D7
D6 –D1
D0
Control Byte In
8 Data Bytes In
Figure 6. SPI Control Interface Write Timing Parameters
SCLK
70%
30%
t CDV
SEN
70%
30%
t S
t S
t HSDIO
t HSEN
t CDZ
SDIO
70%
C7
C6 –C1
C0
D7
D6 –D1
D0
30%
Control Byte In
Bus
Turnaround
16 Data Bytes Out
(SDIO or GPO1)
Figure 7. SPI Control Interface Read Timing Parameters
10
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